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lpddr4是什么意思 lpddr4内存什么意思

  • 来源:电脑问题网
  • 作者:电脑百科
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  • 时间:2015-09-14 10:45
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  电脑问题网-电脑百科 LPDDR4
 
  LPDDR4 2012年3月14日,JEDEC 举办会议,探讨未来如何移动设备需求将推动像 LPDDR4 标准即将出台。2013 年 12 月 30 日,三星宣布它已经开发了第一次 20 毫微米级 8 千兆 (1 GB) LPDDR4 能够在 3,200 Mbit/s 的数据传输,因此提供 50%更高的性能比最快的 LPDDR3 和消费大约 1.1 伏特的能量少了 40%。
  2014 年 8 月 25 日JEDEC发表 JESD209 4 LPDDR4 低功率内存设备标准。
 
  LPDDR4主要的变化包括:
 
  加倍的接口速度和许多因此而导致的电变化
  加倍的内部预取大小和最小传输大小
  从 10 位 DDR 命令/地址总线改为 6 位特别提款权总线
  从一个 32 位宽总线更改为两个独立的 16 位宽巴士
  自刷新被通过专用的命令,而不是被控制在 CKE 行
 
  标准定义了包含 2 个独立的 16 位访问通道的 SDRAM 包,每个连接到每个包的骰子达 2。每个通道是 DRAM 的 16 数据位宽,有其自身的控制/地址引脚,并允许访问的八家银行。因此,包可能连接以下三个方面:
 
  数据线和控制并联连接到 16 位数据总线,只有芯片选择每个通道独立连接。
  两个半宽的 32 位数据总线和控制线并行、 包括芯片选择。
  对两个独立的 16 位宽数据总线
 
  每个模具提供 4、 6、 8、 12 或 16 Gibit的内存,对每个通道的一半。因此,每个银行是十六分之一大小的设备。这被组织成相应的 16384 位 (2048年字节) 的行数 (16 到 64 K)。引伸到 24 和 32 Gibit 计划,但它不是决定是否这将通过增加的行数,其宽度或银行的数目。
 
  大包提供双宽度 (4 频道) 和到 4 骰子每双通道 (每包 8 摇骰子总数) 也被定义。在阵阵的 16 或 32 周期 (256 或 512 位、 32 或 64 个字节) 访问数据。阵阵必须在 64 位边界上开始。
 
  由于时钟频率较高,最低突发长度长于以往的标准,控制信号更高度可复用。LPDDR4 多路复用到一辆巴士 6 位单数据率 CA 的控制和地址线。命令要求 2 时钟周期和编码地址的操作 (例如,激活行、 读取或写入列) 需要 2 命令。例如,一个空闲的芯片从请求读取要求考虑 8 个时钟周期的 4 命令: 激活 1,激活 2、读,CAS-2。芯片选择线 (CS) 是活性高。第一个周期的命令确定被芯片选择高;在第二个周期它是低。

lpddr4是什么意思

  CAS 2 命令用作执行通过数据总线,传输的所有命令的第二个一半,并提供低序位列地址位:
 
  读取命令必须开始列地址是多 4;没有规定交流非零 C0 或 C1 的地址位到内存。
  写命令必须开始列地址是 16; 多C2 和 C3 必须写命令为零。
  模式寄存器读和一些多用途命令也必须随之由 CAS 2 命令,然而所有列位必须都是零 (低)。
 
  可以配置的突发长度为 16,32,或动态选择被 BL 位的读和写操作。一个 DMI (数据掩码/倒转) 信号是与每个 8 数据线、 关联和可以用于最小化的驱动高在数据传输过程中的位数。当高时,其他 8 位被辅发射机和接收机。如果一个字节包含五个或更多的 1 位,DMI 信号可以驱动高,随着三个或更少的数据线。作为信号线被终止低,这降低了功耗。
 
  (替代的用法,在 DMI 用于限制的数据行数的切换每个转入顶多 4,减少串扰。这可由内存控制器期间写入,但不是支持的内存设备。)
 
  数据总线反演可以分别启用读取和写入操作。为戴着面具的写操作 (其中有一个单独的命令代码),DMI 信号的操作取决于是否启用了写反演。
  如果禁用写入 DBI,DMI 高水平指示相应的数据字节是忽略而不写
  如果启用了写入 DBI,DMI,结合数据字节与 5 或更多设置位,低水平指示数据字节,并将其忽略不写。
 
  LPDDR4 还包括一个为"有针对性的行刷新"的机制来避免由于"行锤",在相邻的行上的腐败。三个激活/预充电序列特殊序列指定的行的更多设备指定的阈值 (200,000 到 700,000 每个刷新周期) 被激活。在内部,该设备刷新物理上相邻的行,而不是一个激活命令中指定。
 
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